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Makefile
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# 定义变量，用于存放目标文件和依赖文件的目录
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OBJ_DIR := ./objs
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# $@ 表示目标文件,
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# $^ 表示依赖文件列表去重之后的所有依赖文件,
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# $< 表示第一个依赖文件,
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# $* 表示匹配目标文件名的部分,
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# $% 表示静态模式中的百分号匹配
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# CC 是编译器
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# CC = gcc
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# TARGET 是目标文件
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TARGET = main
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# OBJ 是目标文件依赖的文件
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# OBJ = link.o main.o
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OBJ = $(OBJ_DIR)/link.o $(OBJ_DIR)/main.o
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# 所有的 .o 文件都依赖于 .c 文件
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$(OBJ_DIR)/%.o: %.c
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$(CC) -c $< -o $@
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# 意思是: 目标文件依赖于 OBJ, 执行命令是 $(CC) $(OBJ) -o $(TARGET)
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$(TARGET): $(OBJ)
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$(CC) $(OBJ) -o $(TARGET)
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# # link.o 依赖于 link.c, 执行命令是 $(CC) -c link.c -o link.o
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# # 用于生成目标文件 link.o
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# link.o: link.c
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# $(CC) -c link.c -o $(OBJ_DIR)/link.o
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# # 用于生成目标文件 main.o
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# main.o: main.c
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# $(CC) -c main.c -o $(OBJ_DIR)/main.o
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# 用于清理目标文件和可执行文件
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clean:
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rm -rf $(OBJ) $(TARGET)
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